第17回 ビアのインピーダンス①②
ビアのインピーダンス①
ビアは多層プリント基板で異なる層を電気的に接続します。高周波になると、ビアはインピーダンスの不整合要因になります。
ラインに対して考慮するパラメータが多く、層構成も影響してくるのでビアのインピーダンス整合は基板設計毎に確認が必要です。
とある6層構成の基板に対してビアはビア径 : 0.3mm、ランド径 : 0.7mm、ビアクリアランス : 1.0mm、L1-L6の表層同士を接続しています。
このビアに対して、MAX10GHzの帯域で0.5nsにインピーダンス解析用のTDRパルスを入れた結果が下記になります。
0.5nsから少し経った、ビア相当の位置でインピーダンスが48.6Ω程になりました。
ビアのインピーダンス②
次に同じビアの構成でMAX1GHzの帯域で0.5nsにインピーダンス解析用のTDRパルスを入れた結果が下記になります。
ビア相当の位置ではインピーダンスが49.9Ωでビアのインピーダンス不整合は見えなくなります。
TDRでは入れたパルスによって応答が異なり、解析時の帯域に応じてTDRパルスが異なる為、結果に差が出てきます。
実際は使用する規格、周波数に応じてビアインピーダンスのケアが必要か判断します。
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